#電子設計自動化EDA #機器學習ML
【SoC 開發不易!自帶機器學習的 EDA 來應援】
以機器學習 (ML) 為技術基礎的新型電子設計自動化 (EDA) 工具,讓用戶能更快速地達到客製化晶片設計的目標。相較於人工操作方式,結合暫存器傳輸級到簽核流程 (RTL-to-signoff),可為高階晶片設計人員、電腦輔助設計團隊和矽智財開發者提升多達十倍的工程生產力,以及優化高達 20% 的功耗、效能與面積 (PPA)。工程師可同時快速優化多個模組的流程,並將這些知識用於下一個設計,這對於大型而複雜的系統單晶片 (SoC) 設計尤其重要。
演示影片:
《Cerebrus--INTELLIGENT CHIP EXPLORER》
https://www.cadence.com/en_US/home/tools/digital-design-and-signoff/soc-implementation-and-floorplanning/cerebrus-intelligent-chip-explorer.html?CMP=%20Digital_Cerebus_Media_Adban_09%2021_LP
#益華電腦Cadence #Cerebrus
P.S.《COMPOTECHAsia 電子與電腦》在 YouTube 也有專屬頻道哦!歡迎各位朋友訂閱+開啟小鈴鐺。
https://www.youtube.com/user/compotechasia/videos
同時也有10000部Youtube影片,追蹤數超過2,910的網紅コバにゃんチャンネル,也在其Youtube影片中提到,...
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以機器學習為基礎所開發的智慧晶片設計工具 - Cadence Cerebrus Intelligent Chip Explorer 問世了!!!
Cadence Cerebrus Intelligent Chip Explorer 可實現數位晶片設計自動化和規模化,協助高階晶片設計人員、電腦輔助設計團隊和IP開發者的工程生產力提高多達10倍,優化高達功耗、效能與面積(PPA),更快速地達到晶片設計的目標。
#Cadence數位全流程多元產品之一 #帶動EDA產業革新
有關Cerebrus的更多訊息 >>>www.cadence.com/go/cerebrus
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5G 通訊、超規模運算與汽車趨勢帶動多元晶片設計需求
晶片設計自動化與規模化成快速達成客製化晶片關鍵 💡
Cadence 推出智慧晶片設計工具 Cerebrus ✨
以機器學習為技術基礎,不僅提高 10 倍工程生產力,優化 20% 功耗、效能與面積,還能為客戶提供 5 大益處!
產品實力連三星、瑞薩都認可!快來看看 Cadence Cerebrus 怎麼做 👇
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