DLAB 大概是目前修過最累的課了，主要原因是因為每次寫完code 要gen bit file 傳到FPGA 上執行時都要等很久，到後面整個規模越來越大時，run 一次等個5 分鐘都是常有的 ... ... <看更多>
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⊕課名⊕
數位電路實驗
▲教授▲
范倫達
★修課年度★
109上
￡教了什麼￡（課程大概內容。或是額外學會了什麼東西。）
Verilog
◆上課方式◆（投影片、團體討論、老師教學風格）
實體課:講解下個lab需要的知識 以及剛開學有稍微教一下verilog (過期中好像就沒有了
)
上機課:到實驗室demo
▼考試作業▼
Lab*10 (50%)
上機考*1 (20%)
期末專題*1 (30%)
Lab1 乘法器
Lab2 矩陣乘法
Lab3 Simple ALU
Lab4 Push buttom and LED control
Lab5 LCD control
Lab6 UART
Lab7 矩陣乘法(從RAM讀矩陣元素數值)
Lab8 SD card
Lab9 password cracking(用MD5)
Lab10 VGA
Lab1~3不需要用到板子 用vivado跑模擬就好
Lab4~10需要燒錄到開發版上面 其中後面幾個Lab需要跟外界溝通的protocol都已經幫你
寫好了(VGA SRAM...) 所以不需要考慮protocol的問題
期中上機考3小時(考試當天延到3個半小時)今年是考LCS 要先利用push button輸入字串
然後再利用LCS找出子字串
期末專題2-4人一組 有貪食蛇 俄羅斯方塊 皮卡丘打排球三個題目讓大家選
因為這學期砍到16週的關係 所以原本只有兩個多禮拜可以寫期末專題 但是後來有同學反
應時間太少 所以老師給大家投票後多延兩週 到18週才demo
￥其他￥（是否注重出席率or嚴禁遲到？需要的基礎？）
這門課算是很好拿分 因為期末專題滿分為120分(多出來的20分為加分項目) 再加上lab難
度其實不高 因為不需要自己寫protocol(傳說中許騰尹10年前DLAB要自己刻!?)所以每個l
ab基本上把sample code拿來稍微改一改就完成了
因此除了上機考平均50以外 lab跟期末專題大家分數應該都很不錯
￠最後想說的話￠
如果要走硬體可以考慮修這門課
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